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PDC2023-145915-I00

Financiado

Microelectrónica, nanotecnología y fotónica

EL PROYECTO SE ADENTRA EN LA VANGUARDIA DE LA SEGURIDAD DE HARDWARE EN CIRCUITOS INTEGRADOS (ICS) PARA SISTEMAS CRITICOS. SE CENTRA EN EL USO DE DISPOSITIVOS FET RECONFIGURABLES DE DOBLE DOPADO (DUAL-DOPED RECONFIGURABLE FETS), QU... ver más

01/01/2023

UGR

290K€

Presupuesto del proyecto: 290K€

Líder del proyecto

UNIVERSIDAD DE GRANADA No se ha especificado una descripción o un objeto social para esta compañía.

Total investigadores 5509

Fecha límite participación Sin fecha límite de participación.

Financiación concedida El organismo AGENCIA ESTATAL DE INVESTIGACIÓN notifico la concesión del proyecto el día 2023-01-01 No tenemos la información de la convocatoria

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UGR

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Líder del proyecto

UNIVERSIDAD DE GRANADA No se ha especificado una descripción o un objeto social para esta compañía.

Total investigadores 5509

Presupuesto del proyecto 290K€

Fecha límite de participación Sin fecha límite de participación.

Descripción del proyecto EL PROYECTO SE ADENTRA EN LA VANGUARDIA DE LA SEGURIDAD DE HARDWARE EN CIRCUITOS INTEGRADOS (ICS) PARA SISTEMAS CRITICOS. SE CENTRA EN EL USO DE DISPOSITIVOS FET RECONFIGURABLES DE DOBLE DOPADO (DUAL-DOPED RECONFIGURABLE FETS), QUE REPRESENTAN UNA INNOVACION ESENCIAL EN UN ENTORNO TECNOLOGICO CADA VEZ MAS PROPENSO A AMENAZAS DE SEGURIDAD, DESDE LA FASE DE FABRICACION HASTA EL USUARIO FINAL.EL OBJETIVO PRINCIPAL ES DEMOSTRAR LA VIABILIDAD Y EFICACIA DE ESTA TECNOLOGIA PARA FORTALECER LA PROTECCION DEL HARDWARE. ESTO SE LOGRA A TRAVES DE DOS TECNICAS FUNDAMENTALES: CAMOUFLAGING (CAMUFLAJE) Y LOGIC LOCKING (BLOQUEO LOGICO). ESTAS TECNICAS PERMITEN ADAPTAR Y ASEGURAR LAS FUNCIONES LOGICAS DE LOS CIRCUITOS, PROPORCIONANDO UNA DEFENSA LOGICA MAS AVANZADA Y SOLIDA EN COMPARACION CON LAS VARIANTES CMOS TRADICIONALES.EL PROYECTO CONTEMPLA LA CULMINACION EN LA DEMOSTRACION DE UN CIRCUITO SEGURO MEDIANTE UN PROTOTIPO TOTALMENTE FUNCIONAL, QUE ESTARA ENCAPSULADO E INTEGRADO EN UNA PLACA DE CIRCUITO IMPRESO (PCB) DISEÑADA ESPECIFICAMENTE PARA ESTE PROPOSITO.EL PROCESO DE DESARROLLO ABARCA DIVERSAS ETAPAS ESENCIALES, DESDE LA VERIFICACION POR SIMULACION DE LAS PUERTAS LOGICAS, PASANDO POR EL DISEÑO DE LOS LAYOUTS DE LOS CIRCUITOS, LA FABRICACION Y LAS PRUEBAS DE VERIFICACION, HASTA LA FASE DE DIVULGACION DE HALLAZGOS Y RESULTADOS.PARA LLEVAR A CABO EL DISEÑO, SE ESTABLECERAN COLABORACIONES CON LA INDUSTRIA, LO QUE PERMITIRA IDENTIFICAR APLICACIONES DE INTERES Y DE RELEVANCIA INDUSTRIAL QUE PUEDAN BENEFICIARSE DE LAS CAPACIDADES DE PROTECCION OFRECIDAS POR LA TECNOLOGIA DDRFET.LOS CIRCUITOS SERAN FABRICADOS UTILIZANDO LA TECNOLOGIA CMOS ESTANDAR 28FDSOI, GARANTIZANDO LA APLICABILIDAD Y ESCALABILIDAD DE LOS RESULTADOS EN UN ENTORNO INDUSTRIAL.EN RESUMEN, ESTE PROYECTO REPRESENTA UN PASO CRUCIAL HACIA EL FORTALECIMIENTO DE LA SEGURIDAD DEL HARDWARE EN APLICACIONES CRITICAS. CONTRIBUYE A LA PROTECCION DE SISTEMAS ESENCIALES Y A LA PRESERVACION DE LA INTEGRIDAD DE DATOS Y PROCESOS EN UN MUNDO DIGITAL INTERCONECTADO, DONDE LA SEGURIDAD DEL HARDWARE SE HA CONVERTIDO EN UN IMPERATIVO. SEGURIDAD\INGENIERIA INVERSA\LAYOUT\LOGICA\FET\RECONFIGURABLE\HARDWARE

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