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RTI2018-098156-B-C51

Financiado

TECNOLOGIAS INNOVADORAS DE PROCESADORES, ACELERADORES Y REDES, PARA CENTROS DE D...

TECNOLOGIAS INNOVADORAS DE PROCESADORES, ACELERADORES Y REDES, PARA CENTROS DE DATOS Y COMPUTACION DE ALTAS PRESTACIONES COMO SE HA MENCIONADO PREVIAMENTE, ESTE PROYECTO COORDINADO TIENE COMO OBJETIVO GLOBAL DESARROLLAR TECNICAS PARA MEJORAR LA ESCALABILIDAD DE DICHOS SERVIDORES EN TERMINOS DE PRESTACIONES Y ENERGIA, TAMBIEN SE DESARROLLARAN APLICAC... ver más

01/01/2018

UPV

179K€

Presupuesto del proyecto: 179K€

Líder del proyecto

UNIVERSITAT POLITÈCNICA DE VALÈNCIA No se ha especificado una descripción o un objeto social para esta compañía.

Total investigadores 684

Financiación concedida El organismo AGENCIA ESTATAL DE INVESTIGACIÓN notifico la concesión del proyecto el día 2018-01-01 No tenemos la información de la convocatoria

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Líder del proyecto

UNIVERSITAT POLITÈCNICA DE VALÈNCIA No se ha especificado una descripción o un objeto social para esta compañía.

Total investigadores 684

Presupuesto del proyecto 179K€

Descripción del proyecto COMO SE HA MENCIONADO PREVIAMENTE, ESTE PROYECTO COORDINADO TIENE COMO OBJETIVO GLOBAL DESARROLLAR TECNICAS PARA MEJORAR LA ESCALABILIDAD DE DICHOS SERVIDORES EN TERMINOS DE PRESTACIONES Y ENERGIA, TAMBIEN SE DESARROLLARAN APLICACIONES QUE APROVECHEN ESTAS MEJORAS, Y QUE TENGAN UN GRAN IMPACTO EN LOS RETOS 7º (SOCIEDAD DIGITAL), 1º (SALUD) Y 8º (SEGURIDAD),PARA CONTRIBUIR AL OBJETIVO GLOBAL DEL PROYECTO COORDINADO, EN ESTE SUBPROYECTO SE DESARROLLARAN NUEVAS PROPUESTAS EN LAS LINEAS DE INVESTIGACION SEGUIDAS TRADICIONALMENTE POR NUESTRO GRUPO, TRABAJANDO EN TEMAS DE ARQUITECTURA DE LOS NUCLEOS DE PROCESAMIENTO, DEL SUBSISTEMA DE MEMORIA Y DE LAS REDES DE INTERCONEXION, ADEMAS, SE DEDICARA UNA PARTE IMPORTANTE DEL ESFUERZO A MEJORAR LA ARQUITECTURA DE ACELERADORES HARDWARE CON MAYOR PROYECCION FUTURA, GLOBALMENTE SE BUSCA MEJORAR LAS PRESTACIONES AL TIEMPO QUE SE MAXIMIZA LA CAPACIDAD DE CALCULO POR VATIO DE POTENCIA ELECTRICA CONSUMIDA,EN CONCRETO, EN EL AMBITO DE LOS NODOS DE PROCESAMIENTO, SE DESARROLLARA INVESTIGACION SOBRE ARQUITECTURA DE ACELERADORES CUANTICOS (CENTRANDONOS EN EL MOVIMIENTO OPTIMIZADO DE LOS ESTADOS CUANTICOS), ARQUITECTURA DE ACELERADORES PARA REDES NEURONALES (BASADOS EN ARQUITECTURAS SISTOLICAS INTERCONECTABLES), ESTRATEGIAS DE PARTICIONADO DE CACHE (EVITANDO QUE ALGUNAS APLICACIONES SE VEAN SERIAMENTE PERJUDICADAS SIN PERDIDA DE PRESTACIONES GLOBALES) EN PROCESADORES COMERCIALES, ESQUEMAS DE PREBUSQUEDA ADAPTATIVA (DE MANERA INDEPENDIENTE PARA CADA NUCLEO) EN PROCESADORES MULTINUCLEO COMERCIALES, Y REDES EN EL CHIP CON SOPORTE PARA GARANTIAS DE TIEMPO DE TRANSMISION Y DE ANCHOS DE BANDA PARA CADA APLICACION, EN EL CONTEXTO DE OTROS SUBSISTEMAS SE INVESTIGARA SOBRE TECNOLOGIAS DE RED PARA SISTEMAS EXASCALE Y SERVIDORES DE GRAN TAMAÑO (DESARROLLANDO UN NUEVO ENFOQUE PARA RESOLVER GLOBALMENTE EL PROBLEMA DE LA CONGESTION) Y TOPOLOGIAS PARA REDES DE INTERCONEXION FOTONICAS, ARQUITECTURA DE SERVIDORES\DEEP LEARNING\COMPUTACIÓN CUÁNTICA\PROTOTIPADO FPGA

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