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TIN2010-18368

Financiado

MICROARQUITECTURA Y COMPILADORES PARA FUTUROS PROCESADORES II

LA PRINCIPAL FINALIDAD DE ESTE PROYECTO ES INVESTIGAR EN EL DISEÑO ARQUITECTONICO DE LOS FUTUROS PROCESADORES TENIENDO EN CUENTA ESPECIALMENTE LOS NUEVOS ASPECTOS TECNOLOGICOS QUE LO VAN A CONDICIONAR, TANTO EN EL CAMPO DE LOS PRO... ver más

01/01/2010

UPC

242K€

Presupuesto del proyecto: 242K€

Líder del proyecto

Universidad Politécnica de Cataluña No se ha especificado una descripción o un objeto social para esta compañía.

Total investigadores 9

Ver Participantes

Financiación concedida El organismo AGENCIA ESTATAL DE INVESTIGACIÓN notifico la concesión del proyecto el día 2010-01-01

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Participantes

UPC

Lider

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Líder del proyecto

Universidad Politécnica de Cataluña

Total investigadores 9

Presupuesto del proyecto 242K€

Descripción del proyecto LA PRINCIPAL FINALIDAD DE ESTE PROYECTO ES INVESTIGAR EN EL DISEÑO ARQUITECTONICO DE LOS FUTUROS PROCESADORES TENIENDO EN CUENTA ESPECIALMENTE LOS NUEVOS ASPECTOS TECNOLOGICOS QUE LO VAN A CONDICIONAR, TANTO EN EL CAMPO DE LOS PROCESADORES DE ALTO RENDIMIENTO COMO EN LOS DESTINADOS A LA ELECTRONICA DE CONSUMO, FUNDAMENTALMENTE, DOS HAN SIDO LOS FACTORES QUE HAN SUSTENTADO EL AUMENTO DEL RENDIMIENTO EN LOS PROCESADORES: POR UNA LADO LOS CONSTANTES AVANCES EN LOS NIVELES DE INTEGRACION DE LOS TRANSISTORES, Y POR OTRO LADO, EL MANEJO DE NUEVAS Y MAS EFICIENTES TECNICAS ARQUITECTONICAS Y DE COMPILACION, TODAS ESTAS MEJORAS TRAEN CONSIGO UNA SERIE DE RETOS QUE YA ACTUALMENTE SE CONSIDERAN COMO CLAVES EN EL DISEÑO DE LOS PROCESADORES DE LA DECADA QUE ACABAMOS DE COMENZAR: EL LIMITADO PARALELISMO A NIVEL DE INSTRUCCION, EL RETARDO DE LAS REDES DE INTERCONEXION, EL ALTO CONSUMO, LA DISIPACION DE CALOR Y LA FIABILIDAD Y SEGURIDAD DE LOS DISPOSITIVOS,EN ESTE PROYECTO VAMOS A CONSIDERAR LA INFLUENCIA DE ESTOS ASPECTOS EN LA INVESTIGACION DE LOS FUTUROS PROCESADORES, EN CONCRETO, ABORDAREMOS CINCO AREAS QUE CONSIDERAMOS FUNDAMENTALES: (1) EL ESTUDIO DE NUEVAS TECNICAS EN EL DISEÑO DE LA JERAQUIA DE MEMORIA PARA TOLERAR LA CRECIENTE BRECHA ENTRE LAS VELOCIDADES DEL PROCESADOR Y LA MEMORIA; (2) EL DISEÑO EFICIENTE DE CIRCUITOS EN PRESENCIA DE VARIACIONES IMPREVISTAS EN SUS PARAMETROS DE FUNCIONAMIENTO; (3) LA IMPLEMENTACION EFICIENTE DE MAQUINAS VIRTUALES DE BAJA COMPLEJIDAD PERO ALTA POTENCIA DE CALCULO; (4) EL DISEÑO DE NUEVOS PROCESADORES MULTITHREADED PARA APROVECHAR EL PARALELISMO A NIVEL DE THREAD; (5) LA IMPLEMENTACION DE SISTEMAS DE DETECCION DE INTRUSION PARA ASEGURAR UN ALTO GRADO DE SEGURIDAD EN EL COMPUTADOR,

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