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PID2019-105660RB-C21

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JERARQUIA DE MEMORIA, GESTION DE TAREAS Y OPTIMIZACION DE APLICACIONES

EL CONTINUO AVANCE EN LA ESCALA DE INTEGRACION HA PERMITIDO AUMENTAR EL NIVEL DE PARALELISMO Y LOS RECURSOS DISPONIBLES TANTO EN SERVIDORES DE CALCULO COMO EN SISTEMAS EMPOTRADOS Y DISPOSITIVOS PORTATILES, LA FINALIDAD DE ESTE SUB... ver más

01/01/2019

UNIZAR

198K€

Presupuesto del proyecto: 198K€

Líder del proyecto

UNIVERSIDAD DE ZARAGOZA. OFICINA DE TRANSFERE... No se ha especificado una descripción o un objeto social para esta compañía.

Sin perfil tecnológico

Fecha límite participación Sin fecha límite de participación.

Financiación concedida El organismo AGENCIA ESTATAL DE INVESTIGACIÓN notifico la concesión del proyecto el día 2019-01-01 No tenemos la información de la convocatoria

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Líder del proyecto

UNIVERSIDAD DE ZARAGOZA. OFICINA DE TRANSFERE... No se ha especificado una descripción o un objeto social para esta compañía.

Sin perfil tecnológico

Presupuesto del proyecto 198K€

Fecha límite de participación Sin fecha límite de participación.

Descripción del proyecto EL CONTINUO AVANCE EN LA ESCALA DE INTEGRACION HA PERMITIDO AUMENTAR EL NIVEL DE PARALELISMO Y LOS RECURSOS DISPONIBLES TANTO EN SERVIDORES DE CALCULO COMO EN SISTEMAS EMPOTRADOS Y DISPOSITIVOS PORTATILES, LA FINALIDAD DE ESTE SUB-PROYECTO ES DESARROLLAR TECNICAS PARA APROVECHAR ESTA CRECIENTE CANTIDAD DE RECURSOS DE FORMA EFICIENTE, ATENDIENDO TANTO AL RENDIMIENTO COMO AL CONSUMO ENERGETICO, PARA ELLO SE CENTRA EN TRES ASPECTOS QUE RESULTAN CADA VEZ MAS CRITICOS: LA JERARQUIA DE MEMORIA, LA PLANIFICACION Y BALANCEO DE LOS RECURSOS Y LA OPTIMIZACION DE APLICACIONES, EL PRIMER OBJETIVO ES ANALIZAR LAS POSIBILIDADES DE DISEÑO DE LA JERARQUIA DE MEMORIA PARA IDENTIFICAR SOLUCIONES QUE PERMITAN CONSTRUIR SISTEMAS EN CHIP MASIVAMENTE PARALELOS Y EFICIENTES, PARA ELLO SE PROPONDRAN MECANISMOS QUE PERMITAN MEJORAR EL RENDIMIENTO Y AHORRAR AREA Y ENERGIA EN LA JERARQUIA DE MEMORIA, TANTO EN MULTIPROCESADORES COMO EN SISTEMAS HETEROGENEOS, TENIENDO EN CUENTA EL IMPACTO DE LAS REDES DE INTERCONEXION EN EL CHIP, TAMBIEN SE ESTUDIARA EL SOPORTE NECESARIO PARA SISTEMAS DE TIEMPO REAL, EL SEGUNDO OBJETIVO PERSIGUE DESARROLLAR UNA SERIE DE ALGORITMOS Y HERRAMIENTAS PARA LA PLANIFICACION Y BALANCEO DE CARGA, POR UN LADO SE BUSCA DESARROLLAR SOLUCIONES PORTABLES QUE PERMITAN SIMPLIFICAR LA PROGRAMACION DE APLICACIONES EN ENTORNOS HETEROGENEOS, ASI COMO OPTIMIZAR SU RENDIMIENTO Y CONSUMO ENERGETICO MEDIANTE LA EXPLORACION DE LAS DISTINTAS ALTERNATIVAS DE ASIGNACION, POR OTRO, SE TENDRAN EN CUENTA LAS RESTRICCIONES TERMICAS EN TIEMPO REAL, DESARROLLANDO PLANIFICADORES QUE EVITEN LA FORMACION DE PUNTOS CALIENTES Y EVITEN FALLOS TEMPRANOS O ENVEJECIMIENTO PREMATURO,EL ULTIMO OBJETIVO DE ESTE PROYECTO ES DISEÑAR Y ACELERAR LA EJECUCION DE APLICACIONES APROVECHANDO NUESTRO CONOCIMIENTO DE LA INTERACCION HARDWARE/SOFTWARE, ESTE TRABAJO SE APLICARA TANTO A ENTORNOS DE ALTO RENDIMIENTO COMO A SOLUCIONES A MEDIDA PARA DISPOSITIVOS MOVILES, EN LOS QUE LA EFICIENCIA ENERGETICA ES UNA PRIORIDAD, SE PROPONDRAN SOLUCIONES QUE DESARROLLEN ALGORITMOS MAS EFICIENTES PARA UNA ARQUITECTURA DADA Y SOLUCIONES QUE USEN ACELERADORES HARDWARE A MEDIDA, LAS APLICACIONES OBJETIVO TIENEN GRAN RELEVANCIA CIENTIFICA Y SOCIAL: APLICACIONES DE IMAGENES HIPERESPECTRALES, INTELIGENCIA ARTIFICIAL O SECUENCIACION GENOMICA, JERARQUIA DE MEMORIA CACHE\MULTIPROCESADOR\PRESTACIONES\CONSUMO DE ENERGIA\COMPUTADOR HETEROGENEO\GPGPU\FPGA\ACELERACION DE APLICACIONES

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