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PREMISE

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PRs receivers with Embedded hardware Intrinsic Security Enhancements

The PREMISE project aims to embed Physically Unclonable Function (PUF) technology in Galileo's Public Regulated Service (PRS) receiver security module in order to achieve low cost of silicon security and higher tamper resistance.... ver más

31/03/2014

TECHNIKON

3M€

Presupuesto del proyecto: 3M€

Líder del proyecto

TECHNIKON FORSCHUNGS UND PLANUNGSGESELLSCHAFT... No se ha especificado una descripción o un objeto social para esta compañía.

TRL 4-5

Fecha límite participación Sin fecha límite de participación.

Ver 4 Participantes

Financiación concedida El organismo FP7 notifico la concesión del proyecto el día 2014-03-31 No tenemos la información de la convocatoria

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Características del participante

Este proyecto no cuenta con búsquedas de partenariado abiertas en este momento.

Información adicional privada

No hay información privada compartida para este proyecto. Habla con el coordinador.

4 Participantes

TECHNIKON

0.00€ | Lider

THALES SIX GTS France

N.D. | Participante

UCLouvain

N.D. | Participante

Intrinsic-ID

N.D. | Participante

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Líder del proyecto

TECHNIKON FORSCHUNGS UND PLANUNGSGESELLSCHAFT... No se ha especificado una descripción o un objeto social para esta compañía.

TRL 4-5

Presupuesto del proyecto 3M€

Fecha límite de participación Sin fecha límite de participación.

Descripción del proyecto The PREMISE project aims to embed Physically Unclonable Function (PUF) technology in Galileo's Public Regulated Service (PRS) receiver security module in order to achieve low cost of silicon security and higher tamper resistance. Security is a vital part of PRS receivers as they handle sensitive data in uncontrolled environments. PRS receivers combine a challenging set of requirements including low-cost, security and tamper-resistance. PREMISE will research and derive the advantages which can be obtained by introducing PUF technology into PRS design, focusing on both the end product itself as well as the manufacturing process. The project will analyze PRS constraints and requirements and combine these with the intrinsic PUF security and cost benefits to obtain architectural building blocks that will serve as a basis for prototyping but also as reference to analyze potential side-channel attacks and countermeasures to protect against these. Major achievements expected are protection against tampering and counterfeiting, higher security at an acceptable cost and robust secure authentication. The work will integrate results from ongoing PUF technology work in the FP7 FET (Future Emerging Technology) scheme. Integrated circuits containing the physical part of the silicon PUFs will be used and integrated to build an FPGA based PREMISE prototype. In this way, we achieve concept validation within the short timeframe of this project.

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