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TIN2010-17541

Financiado

HARDWARE Y SOFTWARE PARA COMPUTACION DE ALTAS PRESTACIONES

LOS OBJETIVOS DE ESTE PROYECTO SON UNA CONTINUACION DE LOS RESULTADOS OBTENIDOS EN EL DESARROLLO DEL PROYECTO TIN2007-67537-C03-01, TOMANDO COMO PUNTO DE PARTIDA ESTOS RESULTADOS ABORDAREMOS NUEVOS OBJETIVOS ORIENTADOS A LA MEJOR... ver más

01/01/2010

USC

224K€

Presupuesto del proyecto: 224K€

Líder del proyecto

UNIVERSIDAD DE SANTIAGO DE COMPOSTELA No se ha especificado una descripción o un objeto social para esta compañía.

Total investigadores 237

Fecha límite participación Sin fecha límite de participación.

Financiación concedida El organismo AGENCIA ESTATAL DE INVESTIGACIÓN notifico la concesión del proyecto el día 2010-01-01 No tenemos la información de la convocatoria

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USC

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Líder del proyecto

UNIVERSIDAD DE SANTIAGO DE COMPOSTELA No se ha especificado una descripción o un objeto social para esta compañía.

Total investigadores 237

Presupuesto del proyecto 224K€

Fecha límite de participación Sin fecha límite de participación.

Descripción del proyecto LOS OBJETIVOS DE ESTE PROYECTO SON UNA CONTINUACION DE LOS RESULTADOS OBTENIDOS EN EL DESARROLLO DEL PROYECTO TIN2007-67537-C03-01, TOMANDO COMO PUNTO DE PARTIDA ESTOS RESULTADOS ABORDAREMOS NUEVOS OBJETIVOS ORIENTADOS A LA MEJORA DE DIVERSOS ASPECTOS DE LA COMPUTACION DE ALTAS PRESTACIONES; MAS CONCRETAMENTE TOMAREMOS COMO PLATAFORMA BASE UNA ARQUITECTURA CONSTELLATION, ARQUITECTURAS PARALELAS ORIENTADAS A LA COMPUTACION GRAFICA, DE RECIENTE APARICION, Y ARQUITECTURAS MULTINUCLEO CPU-GPU HIBRIDAS, FINALMENTE, LA MEJORA DE LAS UNIDADES FUNCIONALES DE LOS PROCESADORES ES TAMBIEN UN ASPECTO IMPORTANTE PARA MEJORAR EL RENDIMIENTO DE LOS SISTEMAS PARALELOS, POR LO TANTO, LOS OBJETIVOS DEL PROYECTO SE ORGANIZAN EN TRES AREAS:1) MEJORA DE RENDIMIENTO EN ARQUITECTURAS MULTINUCLEO, (1) MODELADO DE LA JERARQUIA DE MEMORIA DE LAS NUEVAS ARQUITECTURAS MULTINUCLEO HIBRIDAS CPU-GPU, (2) ADAPTACION DE LAS HERRAMIENTAS DE ANALISIS DE RENDIMIENTO A LAS ARQUITECTURAS MULTINUCLEO HIBRIDAS CPU-GPU, (3) OPTIMIZACION DE PROBLEMAS DE RENDIMIENTO EN LA JERARQUIA DE MEMORIA, (4) DISEÑO DE FIRMAS ESCALABLES PARA MEMORIA TRANSACCIONAL, ADAPTABLES A LA CANTIDAD DE DATOS QUE DEBE MANEJAR, (5) IMPLEMENTACION EFICIENTE DE FIRMAS EN SOFTWARE, (6) DESARROLLO DE TECNICAS PARA TOLERAR LOS ERRORES DE CONCURRENCIA DEBIDOS A VIOLACION DE LA ATOMICIDAD EN SISTEMAS DE MEMORIA TRANSACCIONAL,2) COMPUTACION GRAFICA Y MULTIMEDIA, (1) DESARROLLO DE NUEVOS ALGORITMOS ADAPTATIVOS DE SUBDIVISION DE SUPERFICIES EN TIEMPO REAL CON UN APROVECHAMIENTO DE LAS CARACTERISTICAS DE LAS GPU ACTUALES, (2) MEJORA Y EXTENSION DE NUESTRO ALGORITMO HIBRIDO PARA VISUALIZACION INTERACTIVA DE TERRENOS DIGITALIZADOS HASTA OBTENER UN METODO COMPLETO DE REDERING MULTIRRESOLUCION DE MODELOS HIBRIDOS, INTEGRANDO LAS PARTES BASADAS EN MALLAS Y TRIANGULOS, (3) DESARROLLO DE TECNICAS DE PROYECCION DE ALGORITMOS DE SEGMENTACION Y VISUALIZACION DE IMAGENES EN GPUS, APROVECHANDO LAS CARACTERISTICAS DE LA ARQUITECTURA, PROCESADORES MULTICORE, CON VARIOS HILOS MULTITHREADING, ALTA POTENCIA COMPUTACIONAL Y ELEVADO ANCHO DE BANDA DE MEMORIA, (4) DESARROLLO DE TECNICAS PARA LA IMPLEMENTACION DE TAREAS DE LA CONDIFICACION DE VIDEO EN ARQUITECTURAS ALTAMENTE PARALELAS, MASSIVELY PARALLEL PROCESSOR ARRAYS (MPPAS) Y FPGAS,3) DISEÑO DE UNIDADES FUNCIONALES Y ARITMETICA DEL COMPUTADOR, (1) SIMPLIFICACION DEL REDONDEO DE LOS ALGORITMOS MULTIPLICATIVOS PARA DIVISION, RAIZ CUADRADA Y SUS INVERSOS Y DESARROLLO DE ALGORITMOS PARA LA EVALUACION DE LA POTENCIA CON EXPONENTES NO ENTEROS, (2) MEJORA DE LAS ESTIMACIONES HARDWARE DEL ERROR ACUMULADO EN LAS COMPUTACIONES PUNTO FLOTANTE Y PROPUESTA DE NUEVAS ESTIMACIONES MAS PRECISAS BASADAS EN UNA REPRESENTACION OPTIMIZADA DE LA ARITMETICA DE INTERVALOS, (3) DESARROLLO DE NUEVOS ALGORITMOS Y ARQUITECTURAS PARA OPERACIONES PUNTO FLOTANTE DECIMAL, ENTRE LAS OPERACIONES QUE SE ABORDARAN PODEMOS CITAR LA DIVISION , RAIZ CUADRADA Y SUS INVERSOS Y MULTIPLICACION-SUMA,

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